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INTERNAL BLOCK DIAGRAM
INTERNAL BLOCK DIAGRAM
VDD
__
~50 μ A
VPWR
CS
SCLK
Internal
Bias
Charge
Pump
Overvoltage
Shutdown / POR
Sleep State
DI
DO
OV , POR , SLEEP
GND
EN
~50 μ A
SPI and
Interface
Logic
Typical of All 8 Output Drivers
TLIM
D1
D2
IN5
~50 μ A
SPI Bit 0
Enable
SPI Bit 4
Gate
Drive
Control
Current
Limit
Open
Load
Detect
Current
~650 μ A
D3
D4
D7
D8
Drain
Outputs
IN6
~50 μ A
IN5
+
–
+
S1
S2
+
–
Open/Short Comparator
_
~1.5 V Open/Short Threshold
S3
S4
S7
Source
Outputs
S8
D5
Drain
TLIM
Open
Load
D6
Outputs
Detect
Gate
Drive
Control
Current
Limit
+
Current
~650 μ A
–
S5
Source
+
–
Open/Short Comparator
+ _
~1.5 V Open/Short Threshold
S6
Outputs
Figure 2. 33880 Simplified Internal Block Diagram
33880
Analog Integrated Circuit Device Data
2
Freescale Semiconductor
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